1 /* $NetBSD: qcom,gcc-ipq8074.h,v 1.1.1.2 2018/04/28 18:25:53 jmcneill Exp $ */ 2 3 /* 4 * Copyright (c) 2016-2017, The Linux Foundation. All rights reserved. 5 * 6 * This software is licensed under the terms of the GNU General Public 7 * License version 2, as published by the Free Software Foundation, and 8 * may be copied, distributed, and modified under those terms. 9 * 10 * This program is distributed in the hope that it will be useful, 11 * but WITHOUT ANY WARRANTY; without even the implied warranty of 12 * MERCHANTABILITY or FITNESS FOR A PARTICULAR PURPOSE. See the 13 * GNU General Public License for more details. 14 */ 15 16 #ifndef _DT_BINDINGS_CLOCK_IPQ_GCC_8074_H 17 #define _DT_BINDINGS_CLOCK_IPQ_GCC_8074_H 18 19 #define GPLL0 0 20 #define GPLL0_MAIN 1 21 #define GCC_SLEEP_CLK_SRC 2 22 #define BLSP1_QUP1_I2C_APPS_CLK_SRC 3 23 #define BLSP1_QUP1_SPI_APPS_CLK_SRC 4 24 #define BLSP1_QUP2_I2C_APPS_CLK_SRC 5 25 #define BLSP1_QUP2_SPI_APPS_CLK_SRC 6 26 #define BLSP1_QUP3_I2C_APPS_CLK_SRC 7 27 #define BLSP1_QUP3_SPI_APPS_CLK_SRC 8 28 #define BLSP1_QUP4_I2C_APPS_CLK_SRC 9 29 #define BLSP1_QUP4_SPI_APPS_CLK_SRC 10 30 #define BLSP1_QUP5_I2C_APPS_CLK_SRC 11 31 #define BLSP1_QUP5_SPI_APPS_CLK_SRC 12 32 #define BLSP1_QUP6_I2C_APPS_CLK_SRC 13 33 #define BLSP1_QUP6_SPI_APPS_CLK_SRC 14 34 #define BLSP1_UART1_APPS_CLK_SRC 15 35 #define BLSP1_UART2_APPS_CLK_SRC 16 36 #define BLSP1_UART3_APPS_CLK_SRC 17 37 #define BLSP1_UART4_APPS_CLK_SRC 18 38 #define BLSP1_UART5_APPS_CLK_SRC 19 39 #define BLSP1_UART6_APPS_CLK_SRC 20 40 #define GCC_BLSP1_AHB_CLK 21 41 #define GCC_BLSP1_QUP1_I2C_APPS_CLK 22 42 #define GCC_BLSP1_QUP1_SPI_APPS_CLK 23 43 #define GCC_BLSP1_QUP2_I2C_APPS_CLK 24 44 #define GCC_BLSP1_QUP2_SPI_APPS_CLK 25 45 #define GCC_BLSP1_QUP3_I2C_APPS_CLK 26 46 #define GCC_BLSP1_QUP3_SPI_APPS_CLK 27 47 #define GCC_BLSP1_QUP4_I2C_APPS_CLK 28 48 #define GCC_BLSP1_QUP4_SPI_APPS_CLK 29 49 #define GCC_BLSP1_QUP5_I2C_APPS_CLK 30 50 #define GCC_BLSP1_QUP5_SPI_APPS_CLK 31 51 #define GCC_BLSP1_QUP6_I2C_APPS_CLK 32 52 #define GCC_BLSP1_QUP6_SPI_APPS_CLK 33 53 #define GCC_BLSP1_UART1_APPS_CLK 34 54 #define GCC_BLSP1_UART2_APPS_CLK 35 55 #define GCC_BLSP1_UART3_APPS_CLK 36 56 #define GCC_BLSP1_UART4_APPS_CLK 37 57 #define GCC_BLSP1_UART5_APPS_CLK 38 58 #define GCC_BLSP1_UART6_APPS_CLK 39 59 #define GCC_PRNG_AHB_CLK 40 60 #define GCC_QPIC_AHB_CLK 41 61 #define GCC_QPIC_CLK 42 62 #define PCNOC_BFDCD_CLK_SRC 43 63 #define GPLL2_MAIN 44 64 #define GPLL2 45 65 #define GPLL4_MAIN 46 66 #define GPLL4 47 67 #define GPLL6_MAIN 48 68 #define GPLL6 49 69 #define UBI32_PLL_MAIN 50 70 #define UBI32_PLL 51 71 #define NSS_CRYPTO_PLL_MAIN 52 72 #define NSS_CRYPTO_PLL 53 73 #define PCIE0_AXI_CLK_SRC 54 74 #define PCIE0_AUX_CLK_SRC 55 75 #define PCIE0_PIPE_CLK_SRC 56 76 #define PCIE1_AXI_CLK_SRC 57 77 #define PCIE1_AUX_CLK_SRC 58 78 #define PCIE1_PIPE_CLK_SRC 59 79 #define SDCC1_APPS_CLK_SRC 60 80 #define SDCC1_ICE_CORE_CLK_SRC 61 81 #define SDCC2_APPS_CLK_SRC 62 82 #define USB0_MASTER_CLK_SRC 63 83 #define USB0_AUX_CLK_SRC 64 84 #define USB0_MOCK_UTMI_CLK_SRC 65 85 #define USB0_PIPE_CLK_SRC 66 86 #define USB1_MASTER_CLK_SRC 67 87 #define USB1_AUX_CLK_SRC 68 88 #define USB1_MOCK_UTMI_CLK_SRC 69 89 #define USB1_PIPE_CLK_SRC 70 90 #define GCC_XO_CLK_SRC 71 91 #define SYSTEM_NOC_BFDCD_CLK_SRC 72 92 #define NSS_CE_CLK_SRC 73 93 #define NSS_NOC_BFDCD_CLK_SRC 74 94 #define NSS_CRYPTO_CLK_SRC 75 95 #define NSS_UBI0_CLK_SRC 76 96 #define NSS_UBI0_DIV_CLK_SRC 77 97 #define NSS_UBI1_CLK_SRC 78 98 #define NSS_UBI1_DIV_CLK_SRC 79 99 #define UBI_MPT_CLK_SRC 80 100 #define NSS_IMEM_CLK_SRC 81 101 #define NSS_PPE_CLK_SRC 82 102 #define NSS_PORT1_RX_CLK_SRC 83 103 #define NSS_PORT1_RX_DIV_CLK_SRC 84 104 #define NSS_PORT1_TX_CLK_SRC 85 105 #define NSS_PORT1_TX_DIV_CLK_SRC 86 106 #define NSS_PORT2_RX_CLK_SRC 87 107 #define NSS_PORT2_RX_DIV_CLK_SRC 88 108 #define NSS_PORT2_TX_CLK_SRC 89 109 #define NSS_PORT2_TX_DIV_CLK_SRC 90 110 #define NSS_PORT3_RX_CLK_SRC 91 111 #define NSS_PORT3_RX_DIV_CLK_SRC 92 112 #define NSS_PORT3_TX_CLK_SRC 93 113 #define NSS_PORT3_TX_DIV_CLK_SRC 94 114 #define NSS_PORT4_RX_CLK_SRC 95 115 #define NSS_PORT4_RX_DIV_CLK_SRC 96 116 #define NSS_PORT4_TX_CLK_SRC 97 117 #define NSS_PORT4_TX_DIV_CLK_SRC 98 118 #define NSS_PORT5_RX_CLK_SRC 99 119 #define NSS_PORT5_RX_DIV_CLK_SRC 100 120 #define NSS_PORT5_TX_CLK_SRC 101 121 #define NSS_PORT5_TX_DIV_CLK_SRC 102 122 #define NSS_PORT6_RX_CLK_SRC 103 123 #define NSS_PORT6_RX_DIV_CLK_SRC 104 124 #define NSS_PORT6_TX_CLK_SRC 105 125 #define NSS_PORT6_TX_DIV_CLK_SRC 106 126 #define CRYPTO_CLK_SRC 107 127 #define GP1_CLK_SRC 108 128 #define GP2_CLK_SRC 109 129 #define GP3_CLK_SRC 110 130 #define GCC_PCIE0_AHB_CLK 111 131 #define GCC_PCIE0_AUX_CLK 112 132 #define GCC_PCIE0_AXI_M_CLK 113 133 #define GCC_PCIE0_AXI_S_CLK 114 134 #define GCC_PCIE0_PIPE_CLK 115 135 #define GCC_SYS_NOC_PCIE0_AXI_CLK 116 136 #define GCC_PCIE1_AHB_CLK 117 137 #define GCC_PCIE1_AUX_CLK 118 138 #define GCC_PCIE1_AXI_M_CLK 119 139 #define GCC_PCIE1_AXI_S_CLK 120 140 #define GCC_PCIE1_PIPE_CLK 121 141 #define GCC_SYS_NOC_PCIE1_AXI_CLK 122 142 #define GCC_USB0_AUX_CLK 123 143 #define GCC_SYS_NOC_USB0_AXI_CLK 124 144 #define GCC_USB0_MASTER_CLK 125 145 #define GCC_USB0_MOCK_UTMI_CLK 126 146 #define GCC_USB0_PHY_CFG_AHB_CLK 127 147 #define GCC_USB0_PIPE_CLK 128 148 #define GCC_USB0_SLEEP_CLK 129 149 #define GCC_USB1_AUX_CLK 130 150 #define GCC_SYS_NOC_USB1_AXI_CLK 131 151 #define GCC_USB1_MASTER_CLK 132 152 #define GCC_USB1_MOCK_UTMI_CLK 133 153 #define GCC_USB1_PHY_CFG_AHB_CLK 134 154 #define GCC_USB1_PIPE_CLK 135 155 #define GCC_USB1_SLEEP_CLK 136 156 #define GCC_SDCC1_AHB_CLK 137 157 #define GCC_SDCC1_APPS_CLK 138 158 #define GCC_SDCC1_ICE_CORE_CLK 139 159 #define GCC_SDCC2_AHB_CLK 140 160 #define GCC_SDCC2_APPS_CLK 141 161 #define GCC_MEM_NOC_NSS_AXI_CLK 142 162 #define GCC_NSS_CE_APB_CLK 143 163 #define GCC_NSS_CE_AXI_CLK 144 164 #define GCC_NSS_CFG_CLK 145 165 #define GCC_NSS_CRYPTO_CLK 146 166 #define GCC_NSS_CSR_CLK 147 167 #define GCC_NSS_EDMA_CFG_CLK 148 168 #define GCC_NSS_EDMA_CLK 149 169 #define GCC_NSS_IMEM_CLK 150 170 #define GCC_NSS_NOC_CLK 151 171 #define GCC_NSS_PPE_BTQ_CLK 152 172 #define GCC_NSS_PPE_CFG_CLK 153 173 #define GCC_NSS_PPE_CLK 154 174 #define GCC_NSS_PPE_IPE_CLK 155 175 #define GCC_NSS_PTP_REF_CLK 156 176 #define GCC_NSSNOC_CE_APB_CLK 157 177 #define GCC_NSSNOC_CE_AXI_CLK 158 178 #define GCC_NSSNOC_CRYPTO_CLK 159 179 #define GCC_NSSNOC_PPE_CFG_CLK 160 180 #define GCC_NSSNOC_PPE_CLK 161 181 #define GCC_NSSNOC_QOSGEN_REF_CLK 162 182 #define GCC_NSSNOC_SNOC_CLK 163 183 #define GCC_NSSNOC_TIMEOUT_REF_CLK 164 184 #define GCC_NSSNOC_UBI0_AHB_CLK 165 185 #define GCC_NSSNOC_UBI1_AHB_CLK 166 186 #define GCC_UBI0_AHB_CLK 167 187 #define GCC_UBI0_AXI_CLK 168 188 #define GCC_UBI0_NC_AXI_CLK 169 189 #define GCC_UBI0_CORE_CLK 170 190 #define GCC_UBI0_MPT_CLK 171 191 #define GCC_UBI1_AHB_CLK 172 192 #define GCC_UBI1_AXI_CLK 173 193 #define GCC_UBI1_NC_AXI_CLK 174 194 #define GCC_UBI1_CORE_CLK 175 195 #define GCC_UBI1_MPT_CLK 176 196 #define GCC_CMN_12GPLL_AHB_CLK 177 197 #define GCC_CMN_12GPLL_SYS_CLK 178 198 #define GCC_MDIO_AHB_CLK 179 199 #define GCC_UNIPHY0_AHB_CLK 180 200 #define GCC_UNIPHY0_SYS_CLK 181 201 #define GCC_UNIPHY1_AHB_CLK 182 202 #define GCC_UNIPHY1_SYS_CLK 183 203 #define GCC_UNIPHY2_AHB_CLK 184 204 #define GCC_UNIPHY2_SYS_CLK 185 205 #define GCC_NSS_PORT1_RX_CLK 186 206 #define GCC_NSS_PORT1_TX_CLK 187 207 #define GCC_NSS_PORT2_RX_CLK 188 208 #define GCC_NSS_PORT2_TX_CLK 189 209 #define GCC_NSS_PORT3_RX_CLK 190 210 #define GCC_NSS_PORT3_TX_CLK 191 211 #define GCC_NSS_PORT4_RX_CLK 192 212 #define GCC_NSS_PORT4_TX_CLK 193 213 #define GCC_NSS_PORT5_RX_CLK 194 214 #define GCC_NSS_PORT5_TX_CLK 195 215 #define GCC_NSS_PORT6_RX_CLK 196 216 #define GCC_NSS_PORT6_TX_CLK 197 217 #define GCC_PORT1_MAC_CLK 198 218 #define GCC_PORT2_MAC_CLK 199 219 #define GCC_PORT3_MAC_CLK 200 220 #define GCC_PORT4_MAC_CLK 201 221 #define GCC_PORT5_MAC_CLK 202 222 #define GCC_PORT6_MAC_CLK 203 223 #define GCC_UNIPHY0_PORT1_RX_CLK 204 224 #define GCC_UNIPHY0_PORT1_TX_CLK 205 225 #define GCC_UNIPHY0_PORT2_RX_CLK 206 226 #define GCC_UNIPHY0_PORT2_TX_CLK 207 227 #define GCC_UNIPHY0_PORT3_RX_CLK 208 228 #define GCC_UNIPHY0_PORT3_TX_CLK 209 229 #define GCC_UNIPHY0_PORT4_RX_CLK 210 230 #define GCC_UNIPHY0_PORT4_TX_CLK 211 231 #define GCC_UNIPHY0_PORT5_RX_CLK 212 232 #define GCC_UNIPHY0_PORT5_TX_CLK 213 233 #define GCC_UNIPHY1_PORT5_RX_CLK 214 234 #define GCC_UNIPHY1_PORT5_TX_CLK 215 235 #define GCC_UNIPHY2_PORT6_RX_CLK 216 236 #define GCC_UNIPHY2_PORT6_TX_CLK 217 237 #define GCC_CRYPTO_AHB_CLK 218 238 #define GCC_CRYPTO_AXI_CLK 219 239 #define GCC_CRYPTO_CLK 220 240 #define GCC_GP1_CLK 221 241 #define GCC_GP2_CLK 222 242 #define GCC_GP3_CLK 223 243 244 #define GCC_BLSP1_BCR 0 245 #define GCC_BLSP1_QUP1_BCR 1 246 #define GCC_BLSP1_UART1_BCR 2 247 #define GCC_BLSP1_QUP2_BCR 3 248 #define GCC_BLSP1_UART2_BCR 4 249 #define GCC_BLSP1_QUP3_BCR 5 250 #define GCC_BLSP1_UART3_BCR 6 251 #define GCC_BLSP1_QUP4_BCR 7 252 #define GCC_BLSP1_UART4_BCR 8 253 #define GCC_BLSP1_QUP5_BCR 9 254 #define GCC_BLSP1_UART5_BCR 10 255 #define GCC_BLSP1_QUP6_BCR 11 256 #define GCC_BLSP1_UART6_BCR 12 257 #define GCC_IMEM_BCR 13 258 #define GCC_SMMU_BCR 14 259 #define GCC_APSS_TCU_BCR 15 260 #define GCC_SMMU_XPU_BCR 16 261 #define GCC_PCNOC_TBU_BCR 17 262 #define GCC_SMMU_CFG_BCR 18 263 #define GCC_PRNG_BCR 19 264 #define GCC_BOOT_ROM_BCR 20 265 #define GCC_CRYPTO_BCR 21 266 #define GCC_WCSS_BCR 22 267 #define GCC_WCSS_Q6_BCR 23 268 #define GCC_NSS_BCR 24 269 #define GCC_SEC_CTRL_BCR 25 270 #define GCC_ADSS_BCR 26 271 #define GCC_DDRSS_BCR 27 272 #define GCC_SYSTEM_NOC_BCR 28 273 #define GCC_PCNOC_BCR 29 274 #define GCC_TCSR_BCR 30 275 #define GCC_QDSS_BCR 31 276 #define GCC_DCD_BCR 32 277 #define GCC_MSG_RAM_BCR 33 278 #define GCC_MPM_BCR 34 279 #define GCC_SPMI_BCR 35 280 #define GCC_SPDM_BCR 36 281 #define GCC_RBCPR_BCR 37 282 #define GCC_RBCPR_MX_BCR 38 283 #define GCC_TLMM_BCR 39 284 #define GCC_RBCPR_WCSS_BCR 40 285 #define GCC_USB0_PHY_BCR 41 286 #define GCC_USB3PHY_0_PHY_BCR 42 287 #define GCC_USB0_BCR 43 288 #define GCC_USB1_PHY_BCR 44 289 #define GCC_USB3PHY_1_PHY_BCR 45 290 #define GCC_USB1_BCR 46 291 #define GCC_QUSB2_0_PHY_BCR 47 292 #define GCC_QUSB2_1_PHY_BCR 48 293 #define GCC_SDCC1_BCR 49 294 #define GCC_SDCC2_BCR 50 295 #define GCC_SNOC_BUS_TIMEOUT0_BCR 51 296 #define GCC_SNOC_BUS_TIMEOUT2_BCR 52 297 #define GCC_SNOC_BUS_TIMEOUT3_BCR 53 298 #define GCC_PCNOC_BUS_TIMEOUT0_BCR 54 299 #define GCC_PCNOC_BUS_TIMEOUT1_BCR 55 300 #define GCC_PCNOC_BUS_TIMEOUT2_BCR 56 301 #define GCC_PCNOC_BUS_TIMEOUT3_BCR 57 302 #define GCC_PCNOC_BUS_TIMEOUT4_BCR 58 303 #define GCC_PCNOC_BUS_TIMEOUT5_BCR 59 304 #define GCC_PCNOC_BUS_TIMEOUT6_BCR 60 305 #define GCC_PCNOC_BUS_TIMEOUT7_BCR 61 306 #define GCC_PCNOC_BUS_TIMEOUT8_BCR 62 307 #define GCC_PCNOC_BUS_TIMEOUT9_BCR 63 308 #define GCC_UNIPHY0_BCR 64 309 #define GCC_UNIPHY1_BCR 65 310 #define GCC_UNIPHY2_BCR 66 311 #define GCC_CMN_12GPLL_BCR 67 312 #define GCC_QPIC_BCR 68 313 #define GCC_MDIO_BCR 69 314 #define GCC_PCIE1_TBU_BCR 70 315 #define GCC_WCSS_CORE_TBU_BCR 71 316 #define GCC_WCSS_Q6_TBU_BCR 72 317 #define GCC_USB0_TBU_BCR 73 318 #define GCC_USB1_TBU_BCR 74 319 #define GCC_PCIE0_TBU_BCR 75 320 #define GCC_NSS_NOC_TBU_BCR 76 321 #define GCC_PCIE0_BCR 77 322 #define GCC_PCIE0_PHY_BCR 78 323 #define GCC_PCIE0PHY_PHY_BCR 79 324 #define GCC_PCIE0_LINK_DOWN_BCR 80 325 #define GCC_PCIE1_BCR 81 326 #define GCC_PCIE1_PHY_BCR 82 327 #define GCC_PCIE1PHY_PHY_BCR 83 328 #define GCC_PCIE1_LINK_DOWN_BCR 84 329 #define GCC_DCC_BCR 85 330 #define GCC_APC0_VOLTAGE_DROOP_DETECTOR_BCR 86 331 #define GCC_APC1_VOLTAGE_DROOP_DETECTOR_BCR 87 332 #define GCC_SMMU_CATS_BCR 88 333 #define GCC_UBI0_AXI_ARES 89 334 #define GCC_UBI0_AHB_ARES 90 335 #define GCC_UBI0_NC_AXI_ARES 91 336 #define GCC_UBI0_DBG_ARES 92 337 #define GCC_UBI0_CORE_CLAMP_ENABLE 93 338 #define GCC_UBI0_CLKRST_CLAMP_ENABLE 94 339 #define GCC_UBI1_AXI_ARES 95 340 #define GCC_UBI1_AHB_ARES 96 341 #define GCC_UBI1_NC_AXI_ARES 97 342 #define GCC_UBI1_DBG_ARES 98 343 #define GCC_UBI1_CORE_CLAMP_ENABLE 99 344 #define GCC_UBI1_CLKRST_CLAMP_ENABLE 100 345 #define GCC_NSS_CFG_ARES 101 346 #define GCC_NSS_IMEM_ARES 102 347 #define GCC_NSS_NOC_ARES 103 348 #define GCC_NSS_CRYPTO_ARES 104 349 #define GCC_NSS_CSR_ARES 105 350 #define GCC_NSS_CE_APB_ARES 106 351 #define GCC_NSS_CE_AXI_ARES 107 352 #define GCC_NSSNOC_CE_APB_ARES 108 353 #define GCC_NSSNOC_CE_AXI_ARES 109 354 #define GCC_NSSNOC_UBI0_AHB_ARES 110 355 #define GCC_NSSNOC_UBI1_AHB_ARES 111 356 #define GCC_NSSNOC_SNOC_ARES 112 357 #define GCC_NSSNOC_CRYPTO_ARES 113 358 #define GCC_NSSNOC_ATB_ARES 114 359 #define GCC_NSSNOC_QOSGEN_REF_ARES 115 360 #define GCC_NSSNOC_TIMEOUT_REF_ARES 116 361 #define GCC_PCIE0_PIPE_ARES 117 362 #define GCC_PCIE0_SLEEP_ARES 118 363 #define GCC_PCIE0_CORE_STICKY_ARES 119 364 #define GCC_PCIE0_AXI_MASTER_ARES 120 365 #define GCC_PCIE0_AXI_SLAVE_ARES 121 366 #define GCC_PCIE0_AHB_ARES 122 367 #define GCC_PCIE0_AXI_MASTER_STICKY_ARES 123 368 #define GCC_PCIE1_PIPE_ARES 124 369 #define GCC_PCIE1_SLEEP_ARES 125 370 #define GCC_PCIE1_CORE_STICKY_ARES 126 371 #define GCC_PCIE1_AXI_MASTER_ARES 127 372 #define GCC_PCIE1_AXI_SLAVE_ARES 128 373 #define GCC_PCIE1_AHB_ARES 129 374 #define GCC_PCIE1_AXI_MASTER_STICKY_ARES 130 375 376 #endif 377