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332 class RISCVPassConfig : public TargetPassConfig {
334   RISCVPassConfig(RISCVTargetMachine &TM, PassManagerBase &PM)
380   return new RISCVPassConfig(*this, PM);
383 FunctionPass *RISCVPassConfig::createRVVRegAllocPass(bool Optimized) {
398 bool RISCVPassConfig::addRegAssignAndRewriteFast() {
408 bool RISCVPassConfig::addRegAssignAndRewriteOptimized() {
419 void RISCVPassConfig::addIRPasses() {
434 bool RISCVPassConfig::addPreISel() {
451 void RISCVPassConfig::addCodeGenPrepare() {
457 bool RISCVPassConfig::addInstSelector() {
463 bool RISCVPassConfig::addIRTranslator() {
468 void RISCVPassConfig::addPreLegalizeMachineIR() {
476 bool RISCVPassConfig::addLegalizeMachineIR() {
481 void RISCVPassConfig::addPreRegBankSelect() {
486 bool RISCVPassConfig::addRegBankSelect() {
491 bool RISCVPassConfig::addGlobalInstructionSelect() {
496 void RISCVPassConfig::addPreSched2() {
503 void RISCVPassConfig::addPreEmitPass() {
516 void RISCVPassConfig::addPreEmitPass2() {
536 void RISCVPassConfig::addMachineSSAOptimization() {
549 void RISCVPassConfig::addPreRegAlloc() {
567 void RISCVPassConfig::addFastRegAlloc() {
573 void RISCVPassConfig::addPostRegAlloc() {